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authorMarek Vasut <marek.vasut+renesas@gmail.com>2019-06-17 19:15:33 +0200
committerMarek Vasut <marek.vasut+renesas@gmail.com>2019-06-22 17:32:59 +0200
commit4891ca8b17c7043fd1b13f321c9e9210b504c469 (patch)
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rcar_gen3: drivers: pfc: V3M: Checkpatch cleanup
Checkpatch cleanups of the PFC init code and remaining SoC specific macros. No functional change. Signed-off-by: Marek Vasut <marek.vasut+renesas@gmail.com> Change-Id: I3a9527db01afa909f61efd9556cc291e254a5e33
Diffstat (limited to 'drivers/staging')
-rw-r--r--drivers/staging/renesas/rcar/pfc/V3M/pfc_init_v3m.c879
1 files changed, 439 insertions, 440 deletions
diff --git a/drivers/staging/renesas/rcar/pfc/V3M/pfc_init_v3m.c b/drivers/staging/renesas/rcar/pfc/V3M/pfc_init_v3m.c
index 878cc4b052..7f7cfc6a7c 100644
--- a/drivers/staging/renesas/rcar/pfc/V3M/pfc_init_v3m.c
+++ b/drivers/staging/renesas/rcar/pfc/V3M/pfc_init_v3m.c
@@ -13,434 +13,434 @@
#include "../pfc_regs.h"
/* Pin functon bit */
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-
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-
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-#define PUEN1_PUEN_VI0_DATA3 ((uint32_t)1U << 6U)
-#define PUEN1_PUEN_VI0_DATA2 ((uint32_t)1U << 5U)
-#define PUEN1_PUEN_VI0_DATA1 ((uint32_t)1U << 4U)
-#define PUEN1_PUEN_VI0_DATA0 ((uint32_t)1U << 3U)
-#define PUEN1_PUEN_VI0_VSYNC_N ((uint32_t)1U << 2U)
-#define PUEN1_PUEN_VI0_HSYNC_N ((uint32_t)1U << 1U)
-#define PUEN1_PUEN_VI0_CLKENB ((uint32_t)1U << 0U)
-
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+#define PUD2_PUD_CANFD_CLK ((uint32_t)1U << 31U)
+#define PUD2_PUD_CANFD1_RX ((uint32_t)1U << 30U)
+#define PUD2_PUD_CANFD1_TX ((uint32_t)1U << 29U)
+#define PUD2_PUD_CANFD0_RX ((uint32_t)1U << 28U)
+#define PUD2_PUD_CANFD0_TX ((uint32_t)1U << 27U)
+#define PUD2_PUD_AVB0_AVTP_CAPTURE ((uint32_t)1U << 26U)
+#define PUD2_PUD_AVB0_AVTP_MATCH ((uint32_t)1U << 25U)
+#define PUD2_PUD_AVB0_LINK ((uint32_t)1U << 24U)
+#define PUD2_PUD_AVB0_PHY_INT ((uint32_t)1U << 23U)
+#define PUD2_PUD_AVB0_MAGIC ((uint32_t)1U << 22U)
+#define PUD2_PUD_AVB0_MDC ((uint32_t)1U << 21U)
+#define PUD2_PUD_AVB0_MDIO ((uint32_t)1U << 20U)
+#define PUD2_PUD_AVB0_TXCREFCLK ((uint32_t)1U << 19U)
+#define PUD2_PUD_AVB0_TD3 ((uint32_t)1U << 18U)
+#define PUD2_PUD_AVB0_TD2 ((uint32_t)1U << 17U)
+#define PUD2_PUD_AVB0_TD1 ((uint32_t)1U << 16U)
+#define PUD2_PUD_AVB0_TD0 ((uint32_t)1U << 15U)
+#define PUD2_PUD_AVB0_TXC ((uint32_t)1U << 14U)
+#define PUD2_PUD_AVB0_TX_CTL ((uint32_t)1U << 13U)
+#define PUD2_PUD_AVB0_RD3 ((uint32_t)1U << 12U)
+#define PUD2_PUD_AVB0_RD2 ((uint32_t)1U << 11U)
+#define PUD2_PUD_AVB0_RD1 ((uint32_t)1U << 10U)
+#define PUD2_PUD_AVB0_RD0 ((uint32_t)1U << 9U)
+#define PUD2_PUD_AVB0_RXC ((uint32_t)1U << 8U)
+#define PUD2_PUD_AVB0_RX_CTL ((uint32_t)1U << 7U)
+#define PUD2_PUD_SDA2 ((uint32_t)1U << 6U)
+#define PUD2_PUD_SCL2 ((uint32_t)1U << 5U)
+#define PUD2_PUD_SDA1 ((uint32_t)1U << 4U)
+#define PUD2_PUD_SCL1 ((uint32_t)1U << 3U)
+#define PUD2_PUD_SDA0 ((uint32_t)1U << 2U)
+#define PUD2_PUD_SCL0 ((uint32_t)1U << 1U)
+#define PUD2_PUD_VI1_FIELD ((uint32_t)1U << 0U)
+
+#define PUD3_PUD_DIGRF_CLKOUT ((uint32_t)1U << 16U)
+#define PUD3_PUD_DIGRF_CLKIN ((uint32_t)1U << 15U)
+#define PUD3_PUD_RPC_INT_N ((uint32_t)1U << 14U)
+#define PUD3_PUD_RPC_WP_N ((uint32_t)1U << 13U)
+#define PUD3_PUD_RPC_RESET_N ((uint32_t)1U << 12U)
+#define PUD3_PUD_QSPI1_SSL ((uint32_t)1U << 11U)
+#define PUD3_PUD_QSPI1_IO3 ((uint32_t)1U << 10U)
+#define PUD3_PUD_QSPI1_IO2 ((uint32_t)1U << 9U)
+#define PUD3_PUD_QSPI1_MISO_IO1 ((uint32_t)1U << 8U)
+#define PUD3_PUD_QSPI1_MOSI_IO0 ((uint32_t)1U << 7U)
+#define PUD3_PUD_QSPI1_SPCLK ((uint32_t)1U << 6U)
+#define PUD3_PUD_QSPI0_SSL ((uint32_t)1U << 5U)
+#define PUD3_PUD_QSPI0_IO3 ((uint32_t)1U << 4U)
+#define PUD3_PUD_QSPI0_IO2 ((uint32_t)1U << 3U)
+#define PUD3_PUD_QSPI0_MISO_IO1 ((uint32_t)1U << 2U)
+#define PUD3_PUD_QSPI0_MOSI_IO0 ((uint32_t)1U << 1U)
+#define PUD3_PUD_QSPI0_SPCLK ((uint32_t)1U << 0U)
+
+#define MOD_SEL0_sel_hscif0 ((uint32_t)1U << 10U)
+#define MOD_SEL0_sel_scif1 ((uint32_t)1U << 9U)
+#define MOD_SEL0_sel_canfd0 ((uint32_t)1U << 8U)
+#define MOD_SEL0_sel_pwm4 ((uint32_t)1U << 7U)
+#define MOD_SEL0_sel_pwm3 ((uint32_t)1U << 6U)
+#define MOD_SEL0_sel_pwm2 ((uint32_t)1U << 5U)
+#define MOD_SEL0_sel_pwm1 ((uint32_t)1U << 4U)
+#define MOD_SEL0_sel_pwm0 ((uint32_t)1U << 3U)
+#define MOD_SEL0_sel_rfso ((uint32_t)1U << 2U)
+#define MOD_SEL0_sel_rsp ((uint32_t)1U << 1U)
+#define MOD_SEL0_sel_tmu ((uint32_t)1U << 0U)
/* SCIF3 Registers for Dummy write */
#define SCIF3_BASE (0xE6C50000U)
@@ -449,7 +449,7 @@
#define SCFCR_DATA (0x0000U)
/* Realtime module stop control */
-#define CPG_BASE (0xE6150000U)
+#define CPG_BASE (0xE6150000U)
#define CPG_MSTPSR0 (CPG_BASE + 0x0030U)
#define CPG_RMSTPCR0 (CPG_BASE + 0x0110U)
#define RMSTPCR0_RTDMAC (0x00200000U)
@@ -495,7 +495,7 @@ static void StartRtDma0_Descriptor(void)
uint32_t reg;
/* Module stop clear */
- while((mmio_read_32(CPG_MSTPSR0) & RMSTPCR0_RTDMAC) != 0U) {
+ while ((mmio_read_32(CPG_MSTPSR0) & RMSTPCR0_RTDMAC) != 0U) {
reg = mmio_read_32(CPG_RMSTPCR0);
reg &= ~RMSTPCR0_RTDMAC;
cpg_write(CPG_RMSTPCR0, reg);
@@ -562,7 +562,6 @@ void pfc_init_v3m(void)
| GPSR5_QSPI0_MOSI_IO0
| GPSR5_QSPI0_SPCLK);
-
/* initialize peripheral function select */
pfc_reg_write(PFC_IPSR0, IPSR_28_FUNC(0)
| IPSR_24_FUNC(0)
@@ -718,7 +717,7 @@ void pfc_init_v3m(void)
pfc_reg_write(PFC_TDSELCTRL0, 0x00000000);
/* initialize Pull enable */
- pfc_reg_write(PFC_PUEN0,PUEN0_PUEN_VI0_CLK
+ pfc_reg_write(PFC_PUEN0, PUEN0_PUEN_VI0_CLK
| PUEN0_PUEN_TDI
| PUEN0_PUEN_TMS
| PUEN0_PUEN_TCK
@@ -746,7 +745,7 @@ void pfc_init_v3m(void)
| PUEN0_PUEN_DU_DR3
| PUEN0_PUEN_DU_DR2);
- pfc_reg_write(PFC_PUEN1,PUEN1_PUEN_VI1_DATA11
+ pfc_reg_write(PFC_PUEN1, PUEN1_PUEN_VI1_DATA11
| PUEN1_PUEN_VI1_DATA10
| PUEN1_PUEN_VI1_DATA9
| PUEN1_PUEN_VI1_DATA8
@@ -774,7 +773,7 @@ void pfc_init_v3m(void)
| PUEN1_PUEN_VI0_DATA2
| PUEN1_PUEN_VI0_DATA1);
- pfc_reg_write(PFC_PUEN2,PUEN2_PUEN_CANFD_CLK
+ pfc_reg_write(PFC_PUEN2, PUEN2_PUEN_CANFD_CLK
| PUEN2_PUEN_CANFD1_RX
| PUEN2_PUEN_CANFD1_TX
| PUEN2_PUEN_CANFD0_RX
@@ -799,11 +798,11 @@ void pfc_init_v3m(void)
| PUEN2_PUEN_AVB0_RX_CTL
| PUEN2_PUEN_VI1_FIELD);
- pfc_reg_write(PFC_PUEN3,PUEN3_PUEN_DIGRF_CLKOUT
+ pfc_reg_write(PFC_PUEN3, PUEN3_PUEN_DIGRF_CLKOUT
| PUEN3_PUEN_DIGRF_CLKIN);
/* initialize PUD Control */
- pfc_reg_write(PFC_PUD0,PUD0_PUD_VI0_CLK
+ pfc_reg_write(PFC_PUD0, PUD0_PUD_VI0_CLK
| PUD0_PUD_IRQ0
| PUD0_PUD_FSCLKST_N
| PUD0_PUD_DU_EXODDF_DU_ODDF_DISP_CDE
@@ -829,7 +828,7 @@ void pfc_init_v3m(void)
| PUD0_PUD_DU_DR3
| PUD0_PUD_DU_DR2);
- pfc_reg_write(PFC_PUD1,PUD1_PUD_VI1_DATA11
+ pfc_reg_write(PFC_PUD1, PUD1_PUD_VI1_DATA11
| PUD1_PUD_VI1_DATA10
| PUD1_PUD_VI1_DATA9
| PUD1_PUD_VI1_DATA8
@@ -861,7 +860,7 @@ void pfc_init_v3m(void)
| PUD1_PUD_VI0_HSYNC_N
| PUD1_PUD_VI0_CLKENB);
- pfc_reg_write(PFC_PUD2,PUD2_PUD_CANFD_CLK
+ pfc_reg_write(PFC_PUD2, PUD2_PUD_CANFD_CLK
| PUD2_PUD_CANFD1_RX
| PUD2_PUD_CANFD1_TX
| PUD2_PUD_CANFD0_RX
@@ -869,11 +868,11 @@ void pfc_init_v3m(void)
| PUD2_PUD_AVB0_AVTP_CAPTURE
| PUD2_PUD_VI1_FIELD);
- pfc_reg_write(PFC_PUD3,PUD3_PUD_DIGRF_CLKOUT
+ pfc_reg_write(PFC_PUD3, PUD3_PUD_DIGRF_CLKOUT
| PUD3_PUD_DIGRF_CLKIN);
/* initialize Module Select */
- pfc_reg_write(PFC_MOD_SEL0,0x00000000);
+ pfc_reg_write(PFC_MOD_SEL0, 0x00000000);
// gpio
/* initialize positive/negative logic select */